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Potestad Ordóñez, F. E. (2019). Vulnerabilidad y análisis diferencial mediante inserción de fallos de cifradores Trivium en FPGA y ASIC. https://idus.us.es/items/25556247-1d23-4b5a-83b5-6dc038f336f7
Potestad Ordóñez, Francisco Eugenio. Vulnerabilidad y análisis diferencial mediante inserción de fallos de cifradores Trivium en FPGA y ASIC. 2019. https://idus.us.es/items/25556247-1d23-4b5a-83b5-6dc038f336f7.
Potestad Ordóñez, Francisco Eugenio. Vulnerabilidad y análisis diferencial mediante inserción de fallos de cifradores Trivium en FPGA y ASIC. 2019. https://idus.us.es/items/25556247-1d23-4b5a-83b5-6dc038f336f7.
Potestad Ordóñez, F. E. (2019) Vulnerabilidad y análisis diferencial mediante inserción de fallos de cifradores Trivium en FPGA y ASIC. Available at: https://idus.us.es/items/25556247-1d23-4b5a-83b5-6dc038f336f7.
F. E. Potestad Ordóñez, “Vulnerabilidad y análisis diferencial mediante inserción de fallos de cifradores Trivium en FPGA y ASIC,” 2019. [Online]. Available: https://idus.us.es/items/25556247-1d23-4b5a-83b5-6dc038f336f7
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