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Serna Bravo, P., & Valladolid, U. D. (2022). Comunicación Ethernet entre un ordenador y una FPGA empleando un procesador Teensy. Universidad de Valladolid. https://uvadoc.uva.es/handle/10324/54262
Serna Bravo, Pablo, and Universidad de Valladolid. Comunicación Ethernet entre un ordenador y una FPGA empleando un procesador Teensy. Universidad de Valladolid, 2022. https://uvadoc.uva.es/handle/10324/54262.
Serna Bravo, Pablo, and Universidad de Valladolid. Comunicación Ethernet entre un ordenador y una FPGA empleando un procesador Teensy. Universidad de Valladolid, 2022. https://uvadoc.uva.es/handle/10324/54262.
Serna Bravo, P. and Valladolid, U. D. (2022) Comunicación Ethernet entre un ordenador y una FPGA empleando un procesador Teensy. Universidad de Valladolid. Available at: https://uvadoc.uva.es/handle/10324/54262.
P. Serna Bravo and U. D. Valladolid, “Comunicación Ethernet entre un ordenador y una FPGA empleando un procesador Teensy,” Universidad de Valladolid, 2022. [Online]. Available: https://uvadoc.uva.es/handle/10324/54262
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